B-8-2 400Gbit/s処理をFPGAで実現するマルチコアパケット処理回路の検討(その1)(B-8.通信方式,一般セッション)
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概要
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- 2013-09-03
著者
-
植田 泰輔
株式会社日立製作所中央研究所
-
高瀬 誠由
(株)日立製作所
-
矢島 祐輔
日立コミュニケーションテクノロジー
-
矢島 祐輔
(株)日立製作所通信ネットワーク事業部
-
遠藤 英樹
(株)日立製作所 中央研究所
-
植田 泰輔
(株)日立製作所中央研究所
-
土屋 明彦
(株)日立製作所通信ネットワーク事業部
-
新部 真央
(株)日立製作所通信ネットワーク事業部
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