TOPS DSPアーキテクチャの一考察
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概要
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携帯端末向けの低消費電力な高速画像処理用並列プロセッサを提案する。このアーキテクチャは第一世代DSPを複数個チップ上に作ることを想定し、消費電力を増加させないようにDSP間の接続を行う。多数のプロセッサを並列に動作させることで、プロセッサ当りの演算量を減らすことができるため、低速・低消費電力での高速な処理が可能になる。また、空間的な処理を行うプロセッサと時間的な処理を行うプロセッサを用いることで、時間と空間処理の必要な画像処理が効率的に実行可能になる。
- 社団法人電子情報通信学会の論文
- 2007-01-22
著者
-
西谷 隆夫
首都大学東京大学院システムデザイン研究科
-
西谷 隆夫
首都大学東京システムデザイン学部
-
西谷 隆夫
首都大学東京
-
藤田 八郎
首都大学東京システムデザイン学部情報通信システム工学コース
-
藤田 八郎
首都大学東京システムデザイン研究科
-
鈴木 宏史
首都大学東京システムデザイン研究科
-
藤田 八郎
首都大学東京システムデザイン学部情報通信システムコース
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