ストリーム信号処理用マルチスレッドプロセッサのアーキテクチャ(<特集>実時間処理,組込システム及び一般)
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概要
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本報告では、ソフトウェア無線機等の多様なサンプリングレートの混在するストリーム信号処理を効率良く処理するための、レジスターウィンドウを用いたプロセッサーアーキテクチャを提案する。イベント駆動によりスケジューリングを行うが、FIFOを用いてスレッド切り替え回数を削減することにより高い処理性能を実現する。また、シミュレーションによりソフトウェア無線機等のアプリケーションを念頭においた性能推定を行い、スレッド切り替え損失の削減効果の見通しが得られた。
- 社団法人電子情報通信学会の論文
- 2004-03-11
著者
-
宮本 幸昌
(株)東芝セミコンダクター社
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菅野 伸一
(株)東芝研究開発センター
-
樽家 昌也
(株)東芝研究開発センター
-
大根田 拓
(株)東芝研究開発センター
-
小川 陸
(株)東芝研究開発センター
-
宮本 幸昌
(株)東芝soc研究開発センター
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