論理認識の一手法

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概要

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• 近年、VLSIの大規模、高集積化に伴い、設計精度の向上や設計期間の短縮が要求され、設計の自動化が進んでいるが、一方では、チップ面積の最小化等のため、設計の自由度を生かしたマニュアル設計が必要とされている。その結果、マニュアル設計固有の誤りの混入を避けることができない。そこで我々は、VLSIの設計ミスによる損失を回避することを目的として、レイアウト検証システムFRIEND(User FRIENDly Hierarchical VLSI Layout Verification System)を開発し、実品種に対して運用を行なっている。本稿では、今回新たに開発したFRIENDにおける論理認識の手法及び、適用結果について報告する。

• 一般社団法人情報処理学会の論文
• 1989-03-15

著者

• 羽山 繁

  松下電器産業株式会社

• 羽山 繁

  松下電器産業(株)半導体研究センター

• 井上 雅夫

  松下電器産業(株) 半導体研究センター

• 澤田 義明

  (株)松下ソフトリサーチ

• 田中 節子

  松下電器産業(株)半導体研究センター

• 羽山 繁

  松下電器産業(株)マルチメディア開発センター

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