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Department of Information Science, Faculty of Science, Kochi University | 論文
- シミュレーテッド・アニーリング法に基づいた大規模ブロックにおける標準セルの最適概略配置
- シミュレーテッド・アニーリング法を用いたセル概略配置の座標精度に関する検討(信号処理,LSI,及び一般)
- シミュレーテッド・アニーリング法を用いたセル概略配置の座標精度に関する検討(信号処理, LSI, 及び一般)
- 相転移温度を利用した配置改善の一手法
- フラクタル次元を利用したVLSIレイアウト向きクラスタリング手法
- シミュレーテッド・アニーリング法を用いたセル概略配置の座標精度に関する検討(信号処理, LSI, 及び一般)
- 相転移温度を利用した配置改善の一手法
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