PAPRを低減するサブキャリア位相ホッピングを用いたMIMO-OFDM送信機のFPGA実装(移動通信ワークショップ)
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概要
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MIMO-OFDM伝送におけるサブキャリア位相ホッピング空間分割多重(SPH-SDM)は,誤り訂正符号により得られる周波数ダイバーシチ利得を向上させることで伝送特性を改善する.また,SPH-SDM において複数の位相ホッピング・パターンを用意し,ピーク対平均電力比(PAPR)を最も低減するパターンを選択するSPH-SLM が提案されている.しかしながら, SPH-SLMのハードウェアによるリアルタイム検証は行われていない.本報告では,PAPRを低減するSPH-SLM送信機をFPGAに実装し,その性能や回路規模について明らかにする.実装した送信機は,無線LAN802.11a仕様に準拠した送信アンテナ2本のSPH-SLM送信機であり,並列に配置された32個のIFFTを用いて16個の位相パターンから最適なパターンをリアルタイムに選択する.実装の妥当性を検証するため,送信信号波形におけるPAPRの分布をFPGAボードから取得し,大幅にピークを低減できることを明らかにする.実装した送信機は最大で80MHzのクロックでの動作が保証されており,64QAMでは,伝送レート432Mbpsまでリアルタイムに動作可能である.
- 2007-02-28
著者
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