RSFQ LSI circuit design approach
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概要
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We present the methodology and tools developed to design large scale RSFQ circuits. The approach is based on the standard cell library, rsfq65. The design flow includes the construction of the schematic using standard cell library, simulations and inter-cell delay optimization in VHDL. In order to simplify and improve layout design we use standard Cadence tools such as Design Rule Checker (DRC) and Layout Versus Schematic checker (LVS) as well as developed parametric cell library (pcell) and bias current extractor (ERC).
- 2006-10-26
著者
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Kataeva Irina
Microtechnology and Nanoscience Department, Chalmers University of Technology
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Intiso Samuel
Microtechnology and Nanoscience Department, Chalmers University of Technology
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Tolkacheva Elena
Microtechnology and Nanoscience Department, Chalmers University of Technology
-
Kidiyarova-Shevchenko Anna
Microtechnology and Nanoscience Department, Chalmers University of Technology
-
Kataeva Irina
名古屋大 大学院工学研究科
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Intiso Samuel
Chalmers University Of Technology Microtechnology And Nanoscience
-
Kidiyarova-Shevchenko Anna
Chalmers University of Technology Microtechnology and Nanoscience
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Tolkacheva Elena
Microtechnology And Nanoscience Department Chalmers University Of Technology
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