改良メトリックを用いた実時間処理MIMO-MLDのFPGA実装および性能評価(ブロードバンド無線アクセス技術, IPをサポートする無線アクセス技術, 光無線システム, 無線通信一般, およびRCS/CS各研究会一般テーマ)
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概要
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MLD(Maximum-Likelihood Detection)はMIMO(Multiple-Input Multiple-Output)の最適受信方式として知られているが, メトリック演算に多くの乗算を要することが問題とされている.本稿ではマンハッタンメトリックと相関メトリックの2種の低演算量MLDメトリックを検討し, FPGA上での実装結果を報告する.マンハッタンメトリックは, 一般にMLDに用いられる2乗メトリックに比べ若干の特性劣化を招くものの, メトリック演算に乗算を必要としない.また, 相関メトリックはアンテナ数に対して指数関数的に増大するとされるメトリック演算に必要な乗算回数を, 特性劣化なしでアンテナ数の3乗のオーダーに削減する.これらのメトリックを適用した実時間処理MLD受信機を約200万ゲートのFPGAを用いて試作し, 同一FPGA内に実装したMIMO受信信号生成回路によりその性能を評価した.マンハッタンメトリックを用いた場合には約900 Mbps, 相関メトリックを用いた場合には1 Gbpsを超えるデータ処理速度を実現している.
- 社団法人電子情報通信学会の論文
- 2005-01-21
著者
-
小池 俊昭
京都大学大学院 情報学研究科
-
吉田 進
京都大学大学院 情報学研究科
-
荒木 純道
東京工業大学
-
小池 俊昭
京都大学大学院情報学研究科
-
村田 英一
東京工業大学
-
関 征永
京都大学大学院情報学研究科
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