メモリ規模を削減したPAL方式3次元Y/C分離回路(デジタル・情報家電, 放送用, ゲーム機用システムLSI, 及び一般)
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概要
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27MHz固定クロックによるPAL方式3次元Y/C分離回路を小規模なメモリを使用して実現した方法について述べる。
- 2006-01-20
著者
-
賀井 俊博
三菱電機株式会社電子商品開発研究所
-
井上 剛
株式会社ルネサステクノロジ
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山川 正樹
三菱電機株式会社 先端技術総合研究所 映像処理基板技術部
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山川 正樹
三菱電機株式会社 先端技術総合研究所
-
賀井 俊博
三菱電機株式会社
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賀井 俊博
三菱電機株式会社 先端技術総合研究所
-
東 壮一朗
三菱電機マイコン機器ソフトウェア株式会社
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