アーキテクチャ評価用コンパイラ・ジェネレータの評価
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概要
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We have been developing a Compiler Generator which makes a system designer evaluate his/her architecture easily. In this paper, the performance of the compiler generator is presented. Experimental results show that the compiler generator produces a relatively good backend compiler from the formal architecture information. These results imply the automatic generation of optimizing compilers from architecture descriptions written in HDLs will be possible.
- 九州大学大学院総合理工学研究科の論文
- 1994-12-01
九州大学大学院総合理工学研究科 | 論文
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