FPGAを用いた並列 FFT の実現
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概要
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The FFT is a well known computation method for the frequency analysis of digital signals. For high speed implementation of the FFT, parallel processing by the dedicated hardware is effective. In this paper, an implementation of parallel computation of variable-size FFT onto an FPGA chip is proposed where the objective is to maximize the performance of the FFT computation with respect to the limitation of the logic and memory resources on the selected FPGA chip.
- 埼玉大学総合研究機構地域オープンイノベーションセンターの論文
- 2008-00-00
埼玉大学総合研究機構地域オープンイノベーションセンター | 論文
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