動的再構成可能回路におけるJPEGエンコーダ設計改良とその評価
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概要
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動的再構成可能デバイスは、再構成技術により、限られた面積で複雑な機能を実現でき、容易に修正や拡張を行うことができるデバイスとして注目されている。動的再構成可能デバイスの多くは、粗粒度構成をとっており、コンポーネントが多機能であるため、この機能を最大限に生かすために、パイプライン化などによる高速化とコンポーネントの高い利用効率を得ることが重要である。本研究ではDAPDNA-2を用いたJPEGエンコーダ設計を例に、PE単位のパイプライン構成を最大限に実現するためのメモリ利用、 PEへの演算の割り付け、モジュール構成の変更などについてGUIベースの会話的設計方法を提案し、その効果を確認する。
- 2012-09-11
著者
-
荒木 統行
近畿大学理工学部電気電子工学科
-
神戸 尚志
近畿大学理工学研究科大阪府東大阪市
-
荒木 統行
近畿大学大学院総合理工学研究科
-
澤野 肇
近畿大学大学院総合理工学研究科エレクトロニクス系工学専攻
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