トラフィック解析によるオンチップルータのバンド幅制御(ネットワーク応用,FPGA応用及び一般)
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概要
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組込みアプリケーションの高機能化にともない,組込みシステムにおいてもマルチコアが当たり前となりつつある.複数のコアを接続する手法としてNetwork-on-Chip(NoC)が使われており,同じ構成のルータをチップ上に配置することが多い.一方,組込みシステムではアプリケーションの通信パターンを予め予測できるため,リンクごとにデータ幅を最適化することで性能を維持しつつ,NoCの面積や消費電力を削減できる.このようなヘテロジーニアスなNoCを実現するために,本論文では,ビット幅可変ルータと,各リンクのデータ幅を決定するためのトラフィック解析アルゴリズムを提案する.評価では,最適化されたヘテロジーニアスNoCをホモジーニアスNoCと面積とスループットについて評価し,提案手法によって性能を維持しつつ面積を削減できることを示す.
- 2012-01-18
著者
-
松谷 宏紀
慶應義塾大学理工学部
-
山崎 信行
慶應義塾大学
-
松谷 宏紀
慶應義塾大学:(現)東京大学大学院情報理工学系研究科
-
松谷 宏紀
東京大学
-
山崎 信行
慶應義塾大学理工学部
-
山崎 大輝
慶應義塾大学理工学部情報工学科
-
松谷 宏紀
慶應義塾大学
-
山崎 大輝
慶應義塾大学
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