Practical Fast Clock-Schedule Design Algorithms(<Special Section>Selected Papers from the 18th Workshop on Circuits and Systems in Karuizawa)

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概要

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• In this paper, a practical clock-scheduling engine is introduced. The minimum feasible clock-period is obtained by using a modified Bellman-Ford shortest path algorithm. Then an optimum cost clock-schedule is obtained by using a bipartite matching algorithm. It also provides useful information to circuit synthesis tools. The experiment to a circuit with about 10000 registers and 100000 signal paths shows that a result is obtained within a few minutes. The computation time is almost linear to the circuit size in practice.

• 一般社団法人電子情報通信学会の論文
• 2006-04-01

著者

• TAKAHASHI Atsushi

  Graduate School of Science and Technology, Tokyo Institute of Technology

• Takahashi Atsushi

  Graduate School Of Engineering Osaka University

• Takahashi Atsushi

  Graduate School Of Science And Technology Tokyo Institute Of Technology

• Takahashi Atsushi

  Graduate School Of Engineering Osaka Univ.

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