SDRAMをメインメモリとするMIPS-CPUのFPGA化(工学部:電気学科 電気工学専攻・電子工学専攻・情報通信工学専攻)

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概要

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• In the year of 2003, our laboratory designed CPU of MIPS architecture, one of the representative RISC architectures, in order to study design methodology of a CPU, and implemented it in FPGA. The CPU adopted SRAMs in the FPGA as a main memory. As a next step, a MIPS-CPU with a SDRAM as a main memory has been studied. SDRAM controller module has been designed to cope with the specific features of SDRAMs such as refreshing, address multiplexing, access latency and so on. Designed CPU module has been impemented in a FPGA. The highest operation frequency is found to be 82.50MHz with a program of small steps.

• 2005-03-31

著者

• 堀田 厚生

  愛知工業大学 電子工学専攻

• 森川 良

  愛知工業大学大学院 工学研究科

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