高速・低電力ピクセル並列指紋認証回路手法
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概要
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現在、携帯機器の不正利用を防ぐため。これら機器での指紋による利用者認証が必要とされている。本報告では、このような携帯機器への搭載を可能とする小型・薄型指紋認証システムを実現するため、各ピクセル内にセンサと比較回路を搭載したピクセルアレイによる並列処理で指紋イメージのパタンマッチングを行うピクセル並列指紋認証回路手法を提案する。この回路では入力した指紋データの位置の補正や、ユーザの登録データとの高速・低電力なパタンマッチングを可能とし、この手法を用いる事により、指紋センサと認証回路の融合を可能とした。本回路を指紋認証LSIに搭載し、100ms、6.2mWでの指紋認証動作を確認した。本手法により、指紋認証システムの1チップ化が実現された。
- 2000-05-04
論文 | ランダム
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