オーディオ帯低電圧ΔΣADC回路の検討
スポンサーリンク
概要
- 論文の詳細を見る
3Vの電源電圧で動作するオーディオ用のΔΣ型AD変換器の積分器に対する検討を以前行った。今回、さらに低いVthを持つ素子を用い、電源電圧2vでの動作が可能なことを確認したので報告する。
- 1995-03-27
著者
関連論文
- MOSトランジスタの高周波モデルに関する検討
- C-12-63 CMOS-LNAでNFを最小とするTrサイズの最適化に関する検討(C-12. 集積回路C(増幅回路),一般セッション)
- C-12-28 高周波特性に優れたPADの設計と測定(C-12.集積回路,一般セッション)
- C-12-56 ダミーメタルがオンチップ・スパイラルインダクタに与える影響の検討(C-12. 集積回路AC(RFモデリング),一般セッション)
- C-12-40 オンチップ・スパイラルインダクタの周辺の磁界分布の検討(C-12.集積回路C(アナログ),一般講演)
- C-12-21 高精度なPMOSサンプリングスイッチの構成に関する検討(C-12.集積回路C(アナログ),一般講演)
- C-12-17 チャージポンプ方式降圧型DC-DCコンバータの高効率化に関する検討(C-12.集積回路C(アナログ),一般講演)
- C-12-37 減算器が不要な2ステップフラッシュ形ADCの検討(C-12.集積回路C(アナログ),一般講演)
- C-12-15 ダミーメタルがスパイラルインダクタのQ値に与える影響の検討(C-12.集積回路C(アナログ),一般講演)
- C-12-16 8-bit,5GS/sバイポーラS/H回路の検討(C-12.集積回路C(アナログ),エレクトロニクス2)
- C-2-28 2V動作, 1GHz, A級, CMOSパワーアンプ回路の検討(C-2. マイクロ波A(能動デバイス), エレクトロニクス1)
- C-12-22 カレントミラー回路における電流比ばらつきを低減する構成法(C-12.集積回路C(アナログ))
- 弱反転領域を利用したCMOS基準電圧発生回路の検討
- 素子ばらつきを考慮した, 高精度パイプライン方式A/D変換器の利得誤差低減に関する検討
- 弱反転領域を利用したCMOS基準電圧発生回路の検討(アナログ・デジアナ・センサ,通信用LSI)
- 素子ばらつきを考慮した,高精度パイプライン方式A/D変換器の利得誤差低減に関する検討(アナログ・デジアナ・センサ,通信用LSI)
- A-1-16 1V 以下で動作する, 30Ms/s, MOS S/H 回路における利得誤差、直線性誤差改善の検討
- 5.携帯電話用, 高周波アナログ, アナログ/ディジタル混載LSI(モバイル社会を支える先端技術 : 小型化と使いやすさを極める)
- C-12-28 Si基板上のSpiral InductorにおけるGround Shieldの検討
- 低電圧, 高速DACの周波数特性改善手法について
- 2V動作, 500MHz CMOSミクサ回路の検討
- 1V化ビデオ帯電流モードCMSA A/D変換器の ビットブロック回路の設計
- C-12-30 VCO回路のジッタシミュレーションに関する検討
- C-12-26 スイッチトキャパシタ方式MOS A-Dコンバータのキャリブレーション技術の検討
- 1V化 ビデオ帯 電流モードCMOS A/D変換器のビットブロック回路の設計
- 90nmCMOSで何を実現するのか : その1(パッシブ型〓Δ変調器の場合)
- V_ばらつきの影響を低減した電流ミラー回路の検討
- 高精度低電圧電流ミラー回路の検討
- C-12-35 フィードフォワードによるCMOS TIAの安定化、広帯域化の検討(C-12. 集積回路C(アナログ), エレクトロニクス2)
- パイプライン形ADCにおけるディジタルコレクション回路の検討
- パイプライン形A/D変換器におけるディジタルコレクション回路の検討
- ビデオ帯低電圧電流モードサンプルホールド回路の検討
- 90nm CMOSで何を実現するのか : その2(200MHzローパスフィルタの場合)
- 1MHz,1V出力, 降圧形CMOS DC-DCコンバータの出力回路の検討
- グランドラインでの電圧降下の影響を受けない電流源と入力ディジタル符号に依存する時定数変化のない出力端子構成とを用いたMOS、14ビット、高速DACの検討(アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- グランドラインでの電圧降下の影響を受けない電流源と入力ディジタル符号に依存する時定数変化のない出力端子構成とを用いたMOS、14ビット、高速DACの検討(ADCとDAC,アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- DLLループにおける位相比較器デッドゾーンのジッタに対する影響について
- 電流モード,1.5V,30Ms/s,9〜10ビット CMOSサンプル・ホールド回路
- べき指数可変形ガンマ補正回路の開発
- 「低電圧・低消費電力化アナログ回路技術」 -特集号によせて-
- THE Japanese ELECTRONICS INDUSTORY, Wataru Nakayama, William Boulton and Michael Pecht 著, CHAPMAN & HALL/CRC, 定価 : $44.95
- 中央大学理工学部電気・電子工学科杉本泰博研究室(研究室訪問)
- 新しいシュミット・トリガ型発振回路の検討
- 2V動作、400Msps CMOS D/Aコンバータ回路の検討
- 多値論理を用いたCML回路の高速化の検討
- 多値論理を用いた高速、低電圧CML回路の検討
- シリコンオンチップ,スパイラルインダクタにおける最適なグラウンドシールド構造に関する検討
- 並列構成MOS高速ADCの実現可能性について
- I,Q出力を持つMOS低電圧, 高速VCO回路の検討
- オーディオ帯低電圧ΔΣADC回路の検討
- 標準CMOSプロセスによるRFスパイラルインダクタの特性改善手法
- 電流入力、低電圧、高周波分周回路の検討
- VCOにおけるジッタ解析手法について
- ノイズ発生によるSPICEでの雑音解析時の問題について
- 高速VCO回路の低電圧化の検討
- 差動増幅器を用いた高速化VCOの研究
- CMOS差動形高速VCOの検討
- 電流モードS/H回路の低電圧化の検討
- 電流モードビデオADCの実現可能性について