階層的並列アーキテクチャに基づくOFDMディジタル TV 放送用リアルタイムシミュレータのハードウェア設計
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概要
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地上波テレビ放送においてマルチパスに耐性のある OfDM 力式が検討されている[1]。OFDM の実用化においては、種々の方式が提案され、主にコンピュータシミュレーションによる性能評価が行われている。その結果をもとに変復調装置が開発され、限定されたパラメー夕に対するフィールド実験が行われてきた。近年、ディジタル TV 放送法式の研究においては、アルゴリズム開発からフィールド検証までの時間の短縮化すなわち、種々の方式のフイールドにおける性能評価の効率化が要求されつつある。アルゴリズムの評価をフイールドで行うことを考慮すれば、所望の変復調アルゴリズムやパラメータを自由に設定し、速やかに実時間処理が可能なハードウェア[2]の開発が望まれるが、任意の変復調アルゴリズムを設定してディジタル TV 放送の情報量を実時間処理するような大規模な試験装置の開発は行われていない。本報告では、OFDM の変復調処理に関して汎用 DSP を用いてベンチマークの結果および、階層的並列アーキテクチャの慨念に基づくプログラマブルな OFDM 変復調用リアルタイムシミュレータの設計手法について述べる。
- 社団法人電子情報通信学会の論文
- 1997-03-06
著者
-
太田 弘毅
(独)情報通信研究機構
-
本多 真
ソニー・テクトロニクス株式会社
-
本多 真
ソニー・テクトロニクス株式会社:(現)独立行政法人通信総合研究所
-
太田 弘毅
郵政省通信総合研究所
-
秋田 米生
ソニー・テクトロニクス株式会社
-
秋田 米生
(独)情報通信研究機構:株式会社メビウス
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