Low-Power Area-Efficient Design of Embedded High-Speed A/D Converters (Special Issue on Low-power LSIs and Technologies)
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概要
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In this paper, we present a low-power and area-efficient design method of embedded high-speed A/D converters for mixed analog-digital system LSI's. As the A/D converter topology, a 1.5 bit/stage interleaved pipeline A/D converter is employed, because the basic topology covers a wide range of specifications on the conversion frequency and the resolution. The design method determines the minimum DC supply current, the minimum device sizes and the minimum number of channels to meet the precision given by the specification. This paper also points out that the interleaved pipeline structure is very effective for low-power design of high-speed A/D converters whose sampling frequency is over 100MHz.
- 社団法人電子情報通信学会の論文
- 2000-11-25
著者
-
Kawahito Shoji
Research Institute Of Electronics Shizuoka University
-
Kawahito Shoji
Shizuoka Univ. Hamainatsu‐shi Jpn
-
Kawahito Shoji
Graduate School Of Electronic Science And Techonology Shizuoka University
-
Miyazaki Daisuke
Department Of Applied Physics Faculty Of Engineering Osaka University
-
Miyazaki Daisuke
The Graduate School Of Electronic Science And Technology Shizuoka University
-
KAWAHITO Shoji
the Research Institute of Electronics, Shizuoka University
-
Kawahito Shoji
Department Of Electrical And Electronic Engineering Toyohashi University Of Technology
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