非同期SFQアップダウンカウンタを用いたデジタルDROSの設計(デバイス・一般)
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概要
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高速なデジタルDROSを実現するために、SFQ論理に基づいた超伝導アップダウンカウンタを提案した。DROSからのSFQパルス列の出力間隔は一定とならないため、これに対応させるために非同期式を採用した。設計した6ビットアップダウンカウンタは、論理シミュレータによるシミュレーションにより最小入力間隔33ps(30GHz相当)での動作を確認することができた。これと、弛張振動の周期が1OOpsのDROSを組み合わせることにより10GHzで動作するデジタルDROSの実現の可能性が示唆された。
- 社団法人電子情報通信学会の論文
- 2004-01-16
著者
-
梶田 佳樹
埼玉大学工学部
-
明連 広昭
埼玉大学大学院理工学研究科
-
明連 広昭
埼玉大学工学部
-
高田 進
埼玉大学工学部
-
梶田 佳樹
埼玉大学工学部電気電子システム工学科
-
高田 進
埼玉大学工学部電気電子システム工学科
-
脇水 佳弘
埼玉大学工学部電気電子システム工学科
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