負荷急変時におけるVRMの出力電圧安定化のための電流補償回路(部品・デバイス・材料技術関連)
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概要
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近年,CPUの動作電圧・電流は,低電圧化,大電流化が進んでいる。 さらに,省エネルギー化のため,スタンバイモードおよび休止状態が採用され,また,処理の多様化により,大きくかつハイスルーレートで断続的に駆動電流が変動する状態となっている。このような条件化において,CPUに電力を供給するVRM (Voltage Regulator Module)の出力電圧のレギュレーションは,定格値の±数%以内という厳しい要求がなされている。一般的に,これらの要求を満たすために,コンバータ部のスイッチング周波数を高周波化するとともに多相化することで,見かけ上,応答を高速化し,負荷急変時における出力電圧の変動を抑制する方式がとられている。しかし,今後更なるCPUの低電圧化,大電流化,ハイスルーレート化が進んだ場合,この手法では,定常時におけるスイッチングロスの上昇に伴う,電力効率の低下などを招くと考えられる。そこで,本論文では,負荷急変時のみに低インピーダンスのパスをVRMの入力またはグランドと出力間に設け,出力電圧の変動を抑制するという方式を用いた新しい電流補償回路を提案している。また,シミュレーションにより,入力電圧12V,定格出力電庄1.5VのVRMにおいて,IA⇔50Aの負荷急変時に,出力電圧の変動を±5%以内に抑制可能であることを示している。
- 一般社団法人電子情報通信学会の論文
- 2004-09-03
著者
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