SR11000モデルH1におけるバリア同期の高速化手法(SMPシステム)(デザインガイア2003 : VLSI設計の新しい大地を考える研究会)
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概要
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共有メモリ型計算機において高い並列実効性能を実現するには,並列処理の起動終結時のバリア同期オーバーヘッドを低減することが重要である。ノードを構成する複数のマイクロプロセッサを一斉にしかも高速に起動させる協調型マイクロプロセッサ機構により高い並列実効性能を達成したスーパーテクニカルサーバSR8000の後継シリーズの初代モデルであるSR11000モデルH1は,キャッシュシステムを利用したソフトウェアによるバリア同期方式により,高速なバリア同期処理を実現することで,高い並列実効性能を達成する。本稿では高速バリア同期方式の概要とその高速化手法について述べ,SR11000モデルH1による性能評価結果を紹介する。
- 一般社団法人情報処理学会の論文
- 2003-11-27
著者
-
助川 直伸
(株)日立製作所中央研究所
-
青木 秀貴
日立製作所中央研究所
-
青木 秀貴
(株)日立製作所中央研究所
-
高山 恒一
株式会社 日立製作所 中央研究所
-
中村 友洋
(株)日立製作所 中央研究所
-
松居 昭宏
(株)日立製作所中央研究所
-
高山 恒一
(株)日立製作所中央研究所
-
中村 友洋
(株)日立製作所中央研究所
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