BDD形状を考慮したパス・トランジスタ論理セルによる低消費電力回路レイアウト方式
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概要
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低消費電力化に有効とされるパス・トランジスタ論理のレイアウトに関して,トランジスタが多列配置された専用セル生成に基づくライブラリ・フリーのレイアウト方式を採用することで,これまで課題となっていた配線の複雑度を軽減し,消費電力と遅延時間を削減する方式を提案する.従来よりも大きな部分回路をセルとして生成するとともに,実現すべき論理関数を表現するBDDの形状を考慮したトランジスタ配置を導入する点を特徴とする.ベンチマーク回路と乗算器のWallace Tree部に関して,従来方式ならびにCMOS論理と比較実験を行った結果,エネルギー・遅延積(ED積)の点で優れた結果を得た.
- 社団法人情報処理学会の論文
- 2003-05-15
著者
-
沼 昌宏
神戸大学工学研究科
-
山本 啓輔
神戸大学連携創造本部
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山本 啓輔
神戸大学工学部
-
福岡 一樹
神戸大学大学院自然科学研究科
-
福岡 一樹
神戸大学工学部
-
金銅 恒
川崎マイクロエレクトロニクス株式会社
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