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早稲田大学院基幹理工学研究科情報理工学専攻 | 論文
- 2コアプロセッサL1キャッシュ構成の正確で高速なシミュレーション手法 (ディペンダブルコンピューティング・組込み技術とネットワークに関するワークショップETNET2012)
- RDRアーキテクチャを対象とした部分2重化フォールトセキュア高位合成手法 (ディペンダブルコンピューティング・組込み技術とネットワークに関するワークショップETNET2012)
- HDRアーキテクチャを対象とした高速かつ効率的な複数電源電圧指向の高位合成手法 (VLSI設計技術)
- RDRアーキテクチャを対象とした部分2重化フォールトセキュア高位合成手法 (コンピュータシステム・組込み技術とネットワークに関するワークショップETNET2012)
- 複数のキャッシュ構成を同時に表現するデータ構造とこれを用いた高速で正確な2コアキャッシュシミュレーション
- A-3-7 多数ビデオ入力に対する画像認識ハードウェアの制御方式の提案(A-3.VLSI設計技術,一般セッション)
- スキャンシグネチャを用いたTriple DESに対するスキャンベース攻撃手法(セキュリティ,デザインガイア2011-VLSI設計の新しい大地-)
- スキャンシグネチャを用いたTriple DESに対するスキャンベース攻撃手法(セキュリティ,デザインガイア2011-VLSI設計の新しい大地-)
- State Dependent Scan Flip Flopを用いたRSA暗号回路へのセキュアスキャンアーキテクチャの実装 (システム数理と応用)
- State Dependent Scan Flip Flopを用いたRSA暗号回路へのセキュアスキャンアーキテクチャの実装 (信号処理)
- State Dependent Scan Flip Flopを用いたRSA暗号回路へのセキュアスキャンアーキテクチャの実装 (VLSI設計技術)
- State Dependent Scan Flip Flopを用いたRSA暗号回路へのセキュアスキャンアーキテクチャの実装 (回路とシステム)
- 高集積かつ高周波な回路に対応した複数電源電圧指向の高位合成手法
- 鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装 (画像工学)
- 鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装 (集積回路)
- 鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装 (信号処理)
- 鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装 (VLSI設計技術)
- HDRアーキテクチャを対象とした同時実行指向スケジューリングを用いたクロック設計考慮低電力化高位合成手法 (VLSI設計技術)
- HDRアーキテクチャを対象とした同時実行指向スケジューリングを用いたクロック設計考慮低電力化高位合成手法 (ディペンダブルコンピューティング)
- 2コアアーキテクチャを対象とするトレースベースキャッシュシミュレーションの精度評価