NAKANISHI Hiroaki | Technical Research Laboratory, Shimadzu Corp.
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概要
論文 | ランダム
- 高密度ダイナミック光再構成型ゲートアレーVLSI(デバイスアーキテクチャ,リコンフィギャラブルシステム論文)
- 位相補間によるPLLの特性改善 : 位相補間回路の最適化
- A-1-19 PLLジッタ低減のためのオーバ・サンプリング位相比較器(A-1.回路とシステム,基礎・境界)
- 複数のVCSELを用いたODRGAの再構成速度改善(アナログ・デジアナ・センサ, 通信用LSI)
- 272ゲート規模ODRGA-VLSIの実装評価(アナログ・デジアナ・センサ, 通信用LSI)